Московский Технический Университет Связи и Информатики
Кафедра вычислительной техники и управляющих систем
КУРСОВОЙ ПРОЕКТ
Устройство сбора данных
Группа ПС0702
Хотынский К.С
Вариант №26
Москва 2010
Содержание
Введение
Задание
Структурная схема и состав УСД
Разработка блока выработки адреса ЗУ
Разработка блока выработки адресов каналов коммутатора
Словесное описание цикла сбора данных
Синтез управляющего устройства
Абстрактный синтез УУ
Этап структурного синтеза УУ
Список литературы
Введение
Информационно - измерительные и управляющие цифровые микропроцессорные системы, к которым относится проектируемое устройство сбора данных (УСД), предназначены для измерения, сбора, обработки, хранения и отображения информации с реальных объектов. Такие системы используются практически во всех отраслях народного хозяйства для контроля и управления технологическими процессами, накопления статистических данных. В радиотехнических системах и в технике связи УСД используются для обработки сигналов, функционального контроля каналов связи, диагностирования состояния аппаратуры. Первичная информация в УСД поступает, как правило, по каналам от датчиков в виде аналогового напряжения. В УСД информационные каналы опрашиваются. Поступающие из них мгновенные отсчеты сигналов преобразуются в цифровую форму и помещаются в оперативное запоминающее устройство (ОЗУ) с целью последующей их обработки.
Аппаратура УСД состоит из двух частей - операционного и управляющего устройств (ОУ и УУ). УУ является цифровым автоматом, который вырабатывает в некоторой временной последовательности управляющие сигналы. Существуют два принципиально разных подхода к проектированию микропрограммного автомата: использование принципа схемной логики и программной логики.
Задание
Спроектировать устройство сбора данных (УСД). Имеется F аналоговых каналов. Необходимо, опрашивая их согласно заданной последовательности, получаемые из каналов аналоговые величины с помощью АЦП преобразовывать в цифровую форму (двоичные слова стандартной длины 1 байт = 8 бит) и помещать в последовательные ячейки некоторой области ЗУ, начиная с ячейки, имеющей адрес G.
Цифровая процессорная система, фрагментом которой является проектируемое УСД, имеет в своем составе ЗУ емкостью Q бит.
Нам требуется: Реализовать УСД в виде процессорного устройства, построенного на принципах схемной логики, с доведением его до уровня функционально-логической схемы.
Исходные данные на курсовой проект приведены в таблице 1.
Таблица 1
Порядок опроса каналов приведен в таблице 2.
Таблица 2
Структурная схема и состав УСД
Структурная схема УСД приведена на рис. 1. В состав УСД входят:
Мультиплексор (MS): имеет F аналоговых входов и m управляющих (адресных) входов. При подаче на адресный вход двоичного числа - адреса - происходит подключение одного из аналоговых каналов, имеющих данный адрес, к выходу MS. Число опрашиваемых аналоговых каналов связано с числом адресных входов k = 2m.
АЦП: имеет 1 аналоговый вход и 8 выходов, по которым в двоичном, параллельном коде выдается число, соответствующее уровню поданного на вход АЦП отсчета аналогового сигнала. Перед началом работы АЦП на него должен быть подан сигнал запуска.
АЦП выполняет преобразования за несколько тактов. После окончания преобразования АЦП выдает сигнал ОК (окончание преобразования) на устройство управления. Сигнал ОК - флаг (обозначается как Тфл), должен быть зафиксирован с помощью триггера до момента окончания записи данных опрашиваемого канала в ячейку памяти ОЗУ.
MS и АЦП берутся как стандартные схемы с соответствующими характеристиками.
Устройство управления на некоторых тактовых интервалах с учетом осведомительных сигналов, поступающих от других устройств (в дальнейшем такие сигналы обозначаются буквой Xi), формирует управляющие сигналы Yn, которые обеспечивают запуск других устройств и согласованную их работу.
В ходе выполнения курсовой работы разрабатываются: ОЗУ, устройство выработки адреса памяти, устройство выработки адреса каналов, а также УУ.
Разработка блока выработки адреса ЗУ
Требуется синтезировать устройство, которое могло бы, начиная с определенного начального адреса G, производить формирование последующих адресов, отличающихся друг от друга на единицу. Разработку такого устройства можно осуществить с помощью счетчиков. Длина адресного слова определяется емкостью памяти.
Емкость памяти θ = 2048 = 211
Начальный адрес ячейки памяти G = 6800 16 = 0110 1000 0000 00002
Блок будет содержать три четырехразрядных суммирующих двоичных счетчика с предустановкой. Схема блока представлена на рис. 2.
Рис. 2
Разработка блока выработки адресов каналов коммутатора
Число каналов F = 810. Блок можно синтезировать с использованием трехразрядного двоичного счетчика, последовательно формирующего двоичные адресные числа от 1 до 4 с перекодировкой данной последовательности с помощью дешифратора (DC) и шифратора (CD). После опроса всех каналов срабатывает схема прерывания счета и формируется сигнал сброса счетчика в ноль.
Адрес опрашиваемого канала подается на коммутатор (мультиплексор) параллельным двоичным кодом через ключи. Этот делается для синхронного поступления на мультиплексор всех разрядов адресного слова.
Шифратор – устройство, осуществляющее преобразование десятичных чисел в двоичные. Для обратного преобразования двоичных чисел в небольшие по значению десятичные числа используются дешифраторы. Схема блока выработки адресов каналов коммутатора показана на рис. 3.
Рис. 3
Словесное описание цикла сбора данных
Составим словесное описание работы УСД в виде последовательности выполняемых в нем микроопераций.
1. Цикл сбора данных начинается с того, что в счетчик СТ2 блока выработки адресов ячеек памяти производится запись адреса первой ячейки области памяти ОЗУ, отведенной для хранения данных. Очевидно, что в качестве СТ2 удобно использовать такой счетчик, в котором предусмотрена возможность предустановки начального адреса (НА). Ввод начального адреса осуществляется параллельным кодом. Подав на одни входы установки НА логический ноль (потенциал земли или корпуса), а на другие - логическую единицу (напряжение источника питания), можно обеспечить запись требуемого адреса в счетчик в одном такте.
2. Счетчик СТ2 блока выработки номера канала сбрасывается в «0». Тем самым в нем формируется адрес аналогового канала, опрашиваемого первым.
3. Производится сброс в «0» триггера Тфл (гашение флага). При записи данных первого из опрашиваемого каналов Тфл = 0. Однако перед началом опроса всех последующих каналов, поскольку состояние триггеров флага фиксируется, Тфл = 1. Поэтому эта микрооперация необходима.
4. Адрес аналогового канала из СТ22 выдается на адресные входы коммутатора. Коммутатор подключает первый опрашиваемый канал к входу АЦП.
5. Производится запуск АЦП, и в нем начинается процесс аналого-цифрового преобразования.
6. Проверяется содержимое триггера Тфл. Пока Тфл = 0, устройство пребывает в режиме ожидания окончания преобразования в АЦП. По окончании преобразования АЦП вырабатывает сигнал ОК, устанавливающий Тфл в состоянии 1. Как только Тфл устанавливается в 1, при наличии разрешающего сигнала, осуществляется запись данных с выхода АЦП в требуемую ячейку памяти.
7. В СТ21 подготавливается адрес следующей ячейки ОЗУ путем прибавления единицы к содержимому счетчика (к адресу предыдущей ячейки).
8. В СТ22 формируется адрес следующего аналогового канала путем прибавления единицы к содержимому счетчика.
9. Проверяется содержимое счетчика СТ22. Если (СТ2) = 0, то операции 3-8 повторяются. В противном случае происходит завершение цикла сбора данных (выход из цикла), так все каналы оказываются опрошенными.
На основании словесного описания составим в соответствующем порядке список микроопераций, необходимых для управления ОУ:
y1 – установка в 0 СТ22 (сброс), (СТ2 2 ← 0);
y2 – разрешение записи начального адреса G в СТ21;
уЗ – сброс Тфл (Тфл ← 0);
у4 – разрешение передачи адреса аналогового канала на коммутатор [комм.←(СТ22)];
у5 – запуск АЦП (зап. АЦП);
yб – разрешение записи данных из АЦП в ОП [ОП ← (АЦП) ];
у7 – увеличение на 1 (CT21) приращение счетчика [инкремент СТ21← (СТ21) + 1];
у8 – увеличение на 1 (СТ22) - приращение счетчика [СТ22 ← (СТ22) + 1].
В процессе выполнения цикла сбора данных в ОЗУ УСД вырабатываются осведомительные сигналы: сигнал X1 = 1 — сигнал ОК и сигнал Х2 = 1 - завершение цикла сбора данных (опроса всех каналов). Если количества каналов меньше 16, а используется 16-разрядный счетчик, то необходимо составить схему, вырабатывающую сигнал логической единицы для обнуления счетчика после опроса всех каналов.